海思 Hi3520A SDK 开发包资料（DVR方案） pcb +原理图

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买家注意：开发板资料售出后不接受退换货，

                拒绝中差评！请谅解！多谢！

Hi3520A SDK 安装以及升级使用说明

第一章 Hi3520A_SDK版本升级操作说明
   如果您是首次安装本SDK，请直接参看第2章。
   
第二章 首次安装SDK
1、Hi3520A SDK包位置
    在"Hi3520A_V100R001***/01.software/board"目录下，您可以看到一个 Hi3520A_SDK_Vx.x.x.x.tgz 的文件，
该文件就是Hi3520A的软件开发包。

2、解压缩SDK包
    在linux服务器上（或者一台装有linux的PC上，主流的linux发行版本均可以），使用命令：tar -zxf Hi3520A_SDK_Vx.x.x.x.tgz ，
解压缩该文件，可以得到一个Hi3520A_SDK_Vx.x.x.x目录。

3、展开SDK包内容
    返回Hi3520A_SDK_Vx.x.x.x目录，运行./sdk.unpack(请用root或sudo权限执行)将会展开SDK包打包压缩存放的内容，请按照提示完成操作。
如果您需要通过WINDOWS操作系统中转拷贝SDK包，请先运行./sdk.cleanup，收起SDK包的内容，拷贝到新的目录后再展开。

4、在linux服务器上安装交叉编译器
    1）安装uclibc交叉编译器（注意，需要有sudo权限或者root权限）：
       进入Hi3520A_SDK_Vx.x.x.x/osdrv/toolchain/arm-hisiv100nptl-linux目录，运行chmod +x cross.install，然后运行./cross.install即可。
    2) 安装glibc交叉编译器（注意，需要有sudo权限或者root权限）：
       进入Hi3520A_SDK_Vx.x.x.x/osdrv/toolchain/arm-hisiv200-linux目录，运行chmod +x cross.install，然后运行./cross.install即可。
    3) 执行source /etc/profile， 安装交叉编译器的脚本配置的环境变量就可以生效了，或者请重新登陆也可。

5、编译osdrv
    参见osdrv目录下readme

6、SDK目录介绍
Hi3520A_SDK_Vx.x.x.x 目录结构如下：   
    |-- sdk.cleanup                 # SDK清理脚本
    |-- sdk.unpack                  # SDK展开脚本
    |-- osdrv                       # 存放操作系统及相关驱动的目录
    |   |-- busybox                 # busybox源代码
    |   |-- drv                     # drv源代码
    |   |-- kernel                  # linux内核源代码
    |   |-- pub                     # 编译好的镜像、工具、drv驱动等
    |   |-- rootfs_scripts          # rootfs源代码
    |   |-- toolchain               # 交叉编译器
    |   |-- tools                   # linux工具源代码
    |   |-- uboot                   # uboot源代码
    |   `-- Makefile                # osdrv Makefile
    |-- package                     # 存放SDK各种压缩包的目录
    |   |-- osdrv.tgz               # linux内核/uboot/rootfs/tools源码压缩包
    |   |-- mpp.tgz                 # 媒体处理平台软件压缩包
    |   `-- image                   # 可供FLASH烧写的映像文件，如内核、根文件系统
    |-- scripts                     # 存放shell脚本的目录
    |-- mpp                         # 存放媒体处理平台的目录
        |-- component               # 组件源代码
        |-- extdrv                  # 板级外围驱动源代码
        |-- include                 # 对外头文件
        |-- ko                      # 内核模块
        |-- lib                     # release版本库以及音频库
        |-- tools                   # 媒体处理相关工具
        `-- sample                  # 样例源代码

HI3520A海思原厂SDK 

主要特点

处理器内核

ARM Cortex A9 @Max. 930MHz

−32KB L1 I-Cache，32KB L1 D-Cache

−256KB L2 Cache

多协议视频编解码

H.264 Baseline Profile Level5.0

H.264 Main Profile Level5.0

MJPEG/JPEG Baseline

视频编解码处理

H.264&JPEG多码流编解码性能：

−16CIF@30fps+16QCIF@30fps编码+16CIF@30fps解码+JPEG抓拍D1@8fps

−8xCIF@30fps+8QCIF@30fps编码+8xCIF@30fps解码+ JPEG D1抓拍@4fps

−4xD1@30fps+4CIF@30fps编码+4xD1@30fps解码+JPEG抓拍960H@4fps

CBR/VBR/ABR码率控制，16Kbit/s～40Mbit/s

编码帧率支持1 fps～60fps

支持感兴趣区域（ROI）编码

提供彩转灰编码

智能视频分析

集成智能分析加速引擎，支持智能运动侦测、周界防范、视频诊断等多种智能分析应用

视频与图形处理

支持de-interlace、图像增强、边缘增强、3D去噪等前、后处理

支持视频、图形输出抗闪烁处理

支持视频1/8～8x缩放

支持图形1/2～2x缩放

支持8个区域的编码前处理OSD叠加

视频层、图形层Alpha叠加

音频编解码

硬件实现多协议音频编码，支持ADPCM、G.711、

G.726

软件实现多协议音频解码

安全引擎

硬件实现AES/DES/3DES加解密算法

数字水印

视频接口

视频输入接口

−4xBT656@108MHz，支持16CIF/8 x D1实时视频输入

−2xBT1120@148.5MHz，支持(咨询特价)80p实时视频输入视频输出接口

−支持HDMI 1.3+VGA +CVBS多视频输出；HDMI与VGA同源输出

−支持1xLCD，或1xBT1120@148.5MHz，或

1xBT656@27MHz数字视频输出；

−HDMI/VGA最高分辨率支持(咨询特价)P@60fps

−提供三层图形层，格式为RGB(咨询特价)、RGB(咨询特价)可配置，最大分辨率为(咨询特价)80

−提供一层硬件鼠标层，格式为RGB(咨询特价)、RGB(咨询特价)可配置，最大分辨率为(咨询特价)8

−提供1层独立的视频PIP层

音频接口

4个标准I2S接口

−2个支持输入

−1个支持输入输出

−1个支持HDMI I2S输出

网络接口

1个GMAC接口

−支持RGMII和MII模式

−支持(咨询特价)0Mbit/s全双工或半双工模式

−(咨询特价)M全双工模式

外围接口

2个SATA2.6接口

−支持PM功能

−支持eSATA

4个UART接口

1个SPI接口，支持4个片选

IR接口、I2C接口、GPIO接口

1个SDIO2.0接口，最大支持32GB

2个USB 2.0 HOST接口，支持Hub功能

存储器接口

1个16bit DDR2/3 SDRAM控制器接口

−最高频率620MHz

−支持ODT功能

−最大容量支持1GB

−支持自动功耗控制

SPI Nor Flash接口

−1、2、4bit SPI Nor Flash

−2个片选

−每个片选最大容量支持32MBytes

NAND Flash接口

−8bit数据位宽

−支持SLC、MLC

−支持1、4、24bit ECC

内置2KB bootrom和10KB SRAM

多种启动模式可配置

bootrom启动

SPI nor flash启动

Nand Flash启动

SDK

基于Linux 3.0的开发包

H.264的高性能PC解码库

芯片物理规格

功耗

−3W典型功耗

−支持多级功耗控制

工作电压

−内核电压为1.0V

−IO电压为3.3V/ 2.5V，容限电压为5V

−DDR2/3 SDRAM接口电压为1.8/1.5V

封装

−RoHS，EHS-FCBGA449

−管脚间距：Core区域为0.8mm，其他区域为(咨询特价)mm

−19mmx19mm封装大小